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简述信息一览：
如何用JK触发器设计计数器
1、先将2个JK触发器接成同步4进制加法计数器，再改成3进制加法器。当计数为3时，输出状态为11，利用11这个状态产生一个复位信号，使两个触发器复位回0，就不会出现计数的3了，最大数是2，即为要求的3进制计数器了。逻辑图（也即仿真图）如下，图中JK触发器是74LS112。
2、首先，把2个JK触发器接成同步加法计数器（是4进制的），再改成3进制就行了。当计数为3时，输出状态为11，就利用11状态产生一个复位信号，使两个触发器复位回0，就不会出现计数的3了，最大数是2，就是要求的3进制计数器了。逻辑图如下（也是仿真图），JK触发器是74LS112。
3、用JK触发器和附加门电路设计一个七进制加法计数器的总体步骤为：①画出计数器的状态转换图。②根据状态图得出JK各个状态变量的逻辑值。③将JK的逻辑状态代入卡诺图进行化简，得出JK表达式。④根据JK表达式，画出计数器的原理图。⑤仿真验证计数器的输出。以下为详细分解：①②步骤比较直观状态图如下。
怎样用jk触发器设计一个8421码十进制同步加法计数器
1、根据计数器的构成原理，必须由四个触发器的状态来表示一位十进制数的四位二进制编码s。而四位编码总共有十六个状态。所以必须去掉其中的六个状态，至于去掉哪六个状态，可有不同的选择，这里考虑去掉1010～1111六个状态，即***用8421BCD码的编码方式来表示一位十进制数。
2、根据计数器的构成原理，必须由四个触发器的状态来表示一位十进制数的四位二进制编码。而四位编码总共有十六个状态。所以必须去掉其中的六个状态，至于去掉哪六个状态，可有不同的选择，这里考虑去掉1010～1111六个状态，即***用8421BCD码的编码方式来表示一位十进制数。
3、码计数器的话每位十进制数字都要对应四个触发器。如果要设计一位数的加1计数器，就要4个触发器。8421BCD码是四位编码方式，而一个JK触发器只能储存一位二进制代码，所以要用四个JK触发器才能构成一个十进制计数器，再在四个输出端接一个74LS48译码器。
如何用下沿触发JK触发器设计一个同步二,四分频电路?
沿触发的JK触发器设计一同步时序电路，其状态图如下图所示，要求电路使用的门电路最少。试用上升沿触发的JK触发器设计一同步时序电路，其状态图如下图所示，要求电路使用的门电路最少。将D触发器接成T触发器，信号接clk，这就成二分频电路了。再接一级就是四分频电路。
下面的两幅图是JK-FF触发器电路，分别是二，四分频电路，希望对你有用。
jk接1输出2分频再串接一个输出4分频再串接2的3次方分频。
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